File:Ternary CAM cell schematic.jpg

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摘要

描述Ternary CAM cell schematic.jpg	English: CMOS Ternary CAM cell consisting of two 6T SRAM cells plus 4 comparison transistors. Normally opposite logic levels, either '0' and '1' or '1' and '0' will be stored in the two cells. For a don't care condition '0' will be stored in both cells so that the match line ML will not be pulled low for any combination of search line (SL) data.
日期	2021年6月3日
來源	自己的作品
作者	Feinhals pengo

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目前	2021年6月3日 (四) 18:12		1,083 × 422（86 KB）	Feinhals pengo	Cross-wiki upload from en.wikipedia.org

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